Simply Better PPAを実現

Fusion Compilerは、独自のRTL-to-GDSIIアーキテクチャを備えており、お客様は設計から何が可能かを再考し、最短パスで最大の差別化を実現することができます。Fusion Compilerは、設定の調整なしで、革新的なレベルの消費電力、性能、面積を、業界最高のTATで実現します。Fusion Compilerの詳細をご覧ください。

お客様の声

Superior Reliability for Automotive Designs
Satoshi Shibatani of Renesas explains the reliability requirements of automotive MCUs and SoCs. He highlights how Fusion Compiler’s native FuSa support improved design robustness by 39% with full-flow optimization & accelerated DCLS implementation.
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      ルネサス:車載チップ設計のための優れた信頼性

      Enabling Arm’s Highest-Performance CPU Core Design
      Haroon Gauhar of Arm outlines the design challenges of high-performance cores, where fast RTL feedback and skew optimization are decisive factors of reaching best frequency. He highlights Fusion Compiler’s dependable and 2X-faster throughput.
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            Arm:Armの高性能CPUコア設計を実現する

            Fusion Compiler Deployment – The Journey So Far
            Raghavendra Swami Sadhu from Samsung India summarizes recent challenges of designing high-performance, full-chip SoCs. He discusses Fusion Compiler’s high-capacity and production-ready R2G flow with DFT support, and how it improved module placement.
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                サムスン:Fusion Compilerの採用 - これまでの道のり

                アプリケーション別Fusion Compilerの実績

                R&Dエキスパートの解説

                Fusion Compiler – Dynamic Power Shaping
                Synopsys’ Fusion Compiler enables power integrity optimization across the RTL-to-GDSII flow.
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                    ダイナミック・パワー・シェーピング(DPS)テクノロジの形式でFusion Compilerに導入されているパワーグリッド・インテグリティの革新的テクノロジが、より堅牢かつ信頼性の高い設計を効率的に実現しているしくみについて、​シノプシスのR&Dディレクター、Tobias Bjerregaardが説明します。

                    CCD Everywhere throughout the RTL-to-GDSII Design Flow with Synopsys’ Fusion Compiler
                    Dr. Aiqun Cao, VP of Engineering at Synopsys, discusses how Fusion Compiler’s unified physical synthesis and common optimization framework enables full-flow concurrent clock and data (CCD) optimization, while ensuring physical convergence downstream.
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                          Fusion CompilerのUPS(Unified Physical Synthesis) と単一の最適化フレームワークが、最終的なフィジカル設計の収束を確保しながら、どのようにしてフルフローのコンカレント・クロック・データ(CCD)の最適化を可能にしているのかについて、​シノプシスのエンジニアリング・バイス・プレジデント、Aiqun Caoが説明します。

                          Golden Signoff Embedded in the RTL-to-GDSII Design Flow with Fusion Compiler
                          Dr. Henry Sheng, group director of R&D at Synopsys, discusses how Fusion Compiler delivers signoff-accurate PPA on high-performance, low-power designs at advanced nodes, and accelerates design schedules by eliminating late surprises and iterations.
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                              Fusion Compilerが先端ノードでの高性能、低電力設計においてサインオフ精度のPPAを実現し、最終段階で発生する不測のリスクや反復を排除しながら、設計スケジュールを短縮している技術について、​シノプシスのR&Dグループ・ディレクター、Henry Shengが説明します。

                              Bold, Different and Smarter: How Synopsys is Innovating to Keep You Ahead of the Curve
                              Sassine Ghazi, GM of Synopsys’ Design Group, discusses how a revolution in digital design was started by creating a single data model for all design, and he describes how Fusion Compiler, the industry’s only RTL-to-GDSII design product, was formed.
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                                    大胆で異色かつよりスマート:時代を先取りするためのシノプシスの革新

                                    シノプシス、デザイン・グループのジェネラルマネージャー Sassine Ghaziが、すべての設計向けに単一データ・モデルを作成することでデジタル設計の革命がどのように始まり、業界唯一のRTL-to-GDSII製品であるFusion Compilerがどのように誕生したかについて語ります。

                                    Digital Implementation: The New Way Forward
                                    Synopsys reinvents design implementation with its revolutionary Fusion Compiler product, building a new architecture around a single data model that fuses synthesis, place & route and signoff technologies in an unprecedented way for simply better PPA
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                                          デジタル・インプリメンテーション:これからの新たな方向

                                          お客様に設計フローのより良いPPAとスループットを提供するために、シノプシスはFusion Compiler™でデザイン・インプリメンテーションの改革を行いました。 

                                          Fusion Compilerは我が社の大胆なイニシアチブの成果であり、PPA最適化のために合成、配置配線(P&R)、サインオフの各技術を前例のない方法で統合した単一データ・モデルを中核とし、新しいアーキテクチャを一から構築したものです。